數字電路圖分析, 數位電路 分析圖中所示電路的邏輯功能

時間 2022-05-01 17:30:08

1樓:匿名使用者

該圖是關於7位奇偶校檢的電路。

按設定的規則,校檢值全為偶時,輸出低電平「無錯」訊號/noerror,異或門的輸出無意義;否則/noerror端輸出高電平,同時相應的異或門輸出乙個相關訊號/dn。

74280本是9bit奇偶訊號產生器,但可能是為了獲得更詳細的奇偶資訊,做了如此複雜的電路。

3塊74280的輸入有這樣的規律:凡位號二進位制的第1bit為1的,接入第1塊進行奇偶校驗,結果進入74138的a;凡位號二進位制的第2bit為1的,接入第2塊進行奇偶校驗,結果進入74138的b;凡位號二進位制的第3bit為1的,接入第3塊進行奇偶校驗,結果進入74138的c。這樣接的目的大概是為了讓74138分辨1是來自哪位。

但是,實際上xor輸出不夠「規則」。比如,輸入的dn中只有一位是「1」時,xor輸出的/dn是對應那一位為「0」;而d7和d1都為「1」、其他位均為「0」時,xor輸出卻是/d1、/d7、/d6三個同時為「1」。同理,d7和d2都為「1」、其他位均為「0」時,或d7和d4都為「1」、其他位均為「0」時,xor輸出都會有3位輸出「1」而其他為「0」。

更多的輸入組合變化情況,需要更多的分析。

水平有限,只能分析到這裡。感覺這個電路要麼專用性很強,要麼設計不夠周到。

2樓:匿名使用者

這個電路應該不是做奇偶校驗用的。

這是校驗輸入資料d7、d6、...、d2、d1是否正確的電路。

1、輸入資料為:000 0000,000 0111,001 1001,001 1110,010 1010,010 1101,011 0011,011 0100,100 1011,100 1100,101 0010,101 0101,110 0001,110 0110,111 1000,111 1111 這16個編碼之一。

2、若輸入資料為上述16個編碼之1,資料無錯,則/noerr為0,輸出/d1、/d2、...、/d6、/d7為1。

3、若輸入資料不是上述16個編碼資料,資料出錯,則/noerr為1,輸出/d1、/d2、...、/d6、/d7指示資料中哪一位出錯。

比如,輸入資料中d1出錯,則輸出/d1為0,其他位為1。

3樓:匿名使用者

根據異或門原件和相關的晶元引腳之間 的關係標出來,然後就可以分析了!

4樓:匿名使用者

你這個圖每人回答,我就看過兩次了,斗膽的說一句,此圖好像有錯誤吧。輸入、輸出、電源都不明確。

5樓:匿名使用者

????自己用ewb512或者multisim分析下就出來了

【數位電路】分析圖中所示電路的邏輯功能

6樓:匿名使用者

這個邏輯圖畫錯了,這個是典型的三人選舉電路,或叫多數表決電路,abc三個人,凡是兩個人同意(輸入變數為1),結果就成立。那3個二輸入端的都是與非門,最右邊的3輸入端的也是與非門,不是與門,輸出端都應該有個小圓才對。

7樓:sunny我哭了

最後運算結果等於零,最後乙個與門是低電平有效的?感覺這電路有點看不懂

數位電路中的狀態圖怎麼看?

8樓:匿名使用者

q是狀態變數,這個電路有兩種狀態,0和1.輸入是a和b,f應該是輸出函式,從真值表看f等於a同或b,就是ab相同的時候f是1,ab不同的時候f為0.

至於狀態跳轉,就是右邊的圈圈啦。

1:假如當前狀態是0,當輸入ab=00的時候,下乙個狀態仍然是0,也就是左上角那個圈圈,意思就是ab=00的時候,從0狀態變成0狀態。同理。

ab=01的時候也是從0跳轉到0。當ab=10或者11的時候,從0跳轉到1.(這是左邊真值表的上面4行)

2:假如當前狀態是1,分析和上面是一樣的。ab=00和10的時候從1跳轉到1,其他兩種從1狀態跳轉到0狀態。

最右邊那張圖,每一次跳轉都有00/1,這個00就是ab輸入的情況,斜槓右邊的1貌似是下乙個狀態值吧。有乙個貌似寫錯了,當前狀態是1,ab為11的時候,跳轉到0,應該是11/0(圖里是11/1).

而**中/右邊的值是f的值。

分析下圖所示邏輯電路的功能。(數位電路)

9樓:匿名使用者

3個1位半加器組成的2位全減器,a(a1a0)-b(b1b0)=f(f1f0),其中圖上的c0=f1,s0=f0,s1=借位。

數位電路:邏輯電路如下圖所示,試分析其邏輯功能。(求大神幫忙!)

10樓:

解:baij1=q2' k1=1

j2=q1 k2=1

z=q2

次態q1=j1q1'=q2'q1'

次態q2=j2q2'=q2'q1

狀態轉移

q2q1/z

00/0-->01/0-->10/1-->00/011-->00

可以du自啟動,zhi輸出3分頻時鐘訊號dao如有意見,歡內迎討論,共同學

容習;如有幫助,請選為滿意回答!

數位電路組合邏輯電路波形圖怎麼畫?有圖

11樓:匿名使用者

1、函式y簡化有問題

正解流程:

y1=ac,y2=bc,

y=(y1+y2)'=(ac+bc)'=[c(a+b)]'=c'+(a+b)'=c'+a'b',而不是y=c'+(ab)' !

2、y波形圖也存在誤差

正確作圖:

線路標註:

j1=q2,k1=q2' ,j2=k2=q1』;

按 qn=j *q' + k' * q;

則 q1n = q2,

初態 q1=q2=0;

第1個脈衝後,q1n = q2 =0,q2n = q1' *q2』+ q1 * q2 =1;

第2個脈衝後,q1n = q2 =1,q2n = q1' *q2』+ q1 * q2 =0;

第3個脈衝後,q1n = q2 =0,q2n = q1' *q2』+ q1 * q2 =0;

完成乙個迴圈

12樓:匿名使用者

函式y簡化也有問題,y1=ac,y2=bc,

y=(y1+y2)'=(ac+bc)'=[c(a+b)]'=c'+(a+b)'=c'+a'b',而不是y=c'+(ab)' !

波形圖後部份也有錯誤!

13樓:黑豹

y = ( ac + bc )'

= ( (a+b) c )'

= ( (a'b')' c )'

= a'b' + c'

原題目化簡錯了。題目出的也差勁,a、b、c 在同一時刻變化。

14樓:小溪

化簡前後的真值表應該一樣,否則化簡有誤。

sram數位電路時序圖分析

15樓:黑豹

數位電路的輸入訊號脈寬copy都有最小時間限制,訊號電平穩定後的持續時間就是脈寬,晶元內部有許多邏輯單元,有些單元的輸入訊號與晶元外的輸入訊號隔著好幾個邏輯門,傳輸需要時間,而且內部電路的邏輯關係是互相牽制的,所以需要足夠的時間完成反饋、鎖存等功能。時間不足會引起邏輯錯誤。

引數是晶元廠家測試的結果,資料手冊裡有說明。

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