1樓：卿巨集扶以彤
下拉電阻是串接電阻後接地，目的是把該點的電壓拉低。也可以說可以提高階口的灌電流能力。
需要用到上拉電阻和下拉電阻的情況還蠻多的，畫圖比較麻煩。
上拉電阻：就是從電源高電平引出的電阻接到輸出。
1，如果電平用oc(集電極開路，ttl)或od(漏極開路，coms)輸出，那麼不用上拉電阻是不能工作的，這個很容易理解，管子沒有電源就不能輸出高電平了。
2，如果輸出電流比較大，輸出的電平就會降低（電路中已經有了乙個上拉電阻，但是電阻太大，壓降太高），就可以用上拉電阻提供電流分量，把電平「拉高」。（就是並乙個電阻在ic內部的上拉電阻上，讓它的壓降小一點）。當然管子按需要該工作**性範圍的上拉電阻不能太小。
當然也會用這個方式來實現閘電路電平的匹配。
需要注意的是，上拉電阻太大會引起輸出電平的延遲。（rc延時）
一般cmos閘電路輸出不能給它懸空，都是接上拉電阻設定成高電平。
下拉電阻：和上拉電阻的原理差不多，只是拉到gnd去而已。那樣電平就會被拉低。下拉電阻一般用於設定低電平或者是阻抗匹配(抗回波干擾)。
2樓：大飛草記
電路中上拉電阻與下拉電阻的含義。
上拉電阻與下拉電阻有什麼區別？
3樓：帳號已登出
一、上拉電阻的作用：
在cmos晶元上，為了防止靜電造成損慎敗旅壞，不用的管腳不能懸空，一般接上拉電阻以降低輸入阻抗， 提供洩荷通路。晶元的管腳加上拉電阻來提高輸出電平，從而提高晶元輸入訊號的雜訊容限，增強抗干擾能力；提高匯流排的抗電磁干擾能力，管腳懸空就比較容易接受外界的電磁干擾。
二、下拉電阻的作用：
提高晶元輸入訊號的雜訊容限：輸入端如果是高阻狀態，或者高阻抗輸入端處於懸空狀態，此時需要加上拉或下拉，以免收到隨機電平而影響電路工作。
同樣如果輸出端處於被動狀態，需要加上拉或下拉，如輸出端僅僅是乙個三極體的集電極。從而提高晶元輸入訊號的雜訊容限增強抗干擾能力。
三、區別：1、含義不同；
上拉枯跡電阻：將乙個不確定的訊號，通過乙個電阻與電源vcc相連，固定在高電平；
下拉電阻：將乙個不確定的訊號，通過乙個電阻與地gnd相連，固定在低電平；
2、作用不同：
上拉是對器件注入電流；灌電流；當乙個接有上拉電阻的io埠設定為輸入狀態時，它的常態為高電平；
下拉電阻：下拉是從器件輸出電流；拉電流；當乙個接有下拉電阻的io埠設定為輸入狀態時，它的常態為低電平；
原理
在上拉電阻所連線的導線上，如果外部元件未啟用，上拉電阻則「微弱地」將輸入電壓訊號「拉高」。當外部元件未連線時，對輸入端來說，外部「看上去」就是高阻抗的。這時，通過上拉電阻可以將輸入埠處的電壓拉高到高電平。
如果外部元件啟用，它將取消上拉電阻所寬凳設定的高電平。通過這樣，上拉電阻可以使引腳即使在未連線外部元件的時候也能保持確定的邏輯電平。
以上內容參考：百科-上拉電阻。
電阻上拉電阻和下拉電阻有什麼區別？
4樓：匿名使用者
上拉確保待機時電平為"1"，下拉確保待機時電平為"0"。
上拉電阻是什麼意思
5樓：陽光的wl哈哈
上拉電阻：顧名思義，就是電源電壓通過乙個電阻連線到訊號上。
上拉電阻作用：1、增大驅動電流能力；2、使乙個訊號沒有作用雹薯時固定在高電平，防止因為干擾導致訊號拉低到低電平，從而損壞負載或者電路；3、晶元引腳內部是oc閘電路，無法辯敗輸出高電平，攜肆顫這個時候上拉電阻可以使晶元輸出高電平；4、上拉電阻對於這個訊號由一定的抗干擾左右。
請問這個電阻是上拉還是下拉，作用是什麼，謝謝
6樓：網友
由邏輯輸入端或輸出端接至電源正端（如vcc）和負端（如gnd）的電阻分別稱為上拉電阻和下拉電阻。
作用：對於邏輯輸入端，在未連線前級訊號的情況下，上（下）拉電阻使得該端處於確定的高（低）電平（應是該端的無效電平）狀態，避免電路工作於錯誤狀態或不穩定狀態。該電阻阻值不能取得太大，以確保有明確的電平狀態；又不能取得太小，以免加重前級驅動的負擔。
對於邏輯輸出端，一般是開路型輸出端需要接上（下）拉電阻。如oc、od輸出端，須外接上拉電阻產生高電平輸出。
7樓：大炮
這個電阻連線埠和gnd,也就是從口線連線到低電平，屬於下拉，如果連線到高電平屬於上拉，作用是匹配線路的終端電阻，降低埠的由於電磁干擾引起的雜訊的電壓水平，防止其引起輸入訊號的跳變。
8樓：網友
接地下拉了，保持零電平。
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